1樓：FPGAer
例化過不帶協議功能的高速介面都知道，一般都是上百根訊號線，一眼看過去頭皮都發麻。連完線，上板除錯的時候，沒有出問題還好，出了問題的話，恨不得把這些訊號線都排查乙個遍，各種訊號是什麼含義，時序是什麼樣的。所以熟悉不熟悉這些底層訊號的含義，有沒有踏過其中的坑這些都是很重要的。
前面的講的是不帶協議的，還有那種帶協議的高速介面，比如PCIE/乙太網/jesd204b/ilk，這些你有調通過證明你對這些協議有了初步的了解，如果能踏過幾個坑的話，那麼估計協議也能明白的差不多了。再說一下做晶元的時候基本上各種IP都是買的，也是拿來就用，但是要找乙個人負責某一塊協議處理IP的話，基本都是精通的這方面協議的專家。
2樓：huakaimanlin
很多說起來容易的事情其實做起來不一定很容易。諸如大飛機不就是造個殼把別人的發動機啥的整合進去麼？
高速介面，難得不在實現，因為基本都是現成的IP，難得在於上板子除錯，穩定性。就拿DDR，你確定你例化個IP上去就一定好使?如果不好使你能快速定位問題並解決這真的是需要綜合知識和經驗。
3樓：Jim0
做工程師為何沒有一點探索精神，這麼說的話晶元也是ip堆起來的。。。
1.不了解乙個ip如何用好它。
2.高速ip的使用相比於普通ip時序更加緊張，對時序分析不仔細了解隨便寫就會出現亞穩態的。
3.最高的當然是自己寫個ip效能跟官方一樣好拉，這樣水平才能提高呀。
4樓：Lorindadan
瀉藥啊，如果你要做的專案對通訊頻寬要求不高，你可以用pll倍頻時鐘的方法勉強實現要求的速度，但是時鐘頻率不可能無限度提公升，跟器件工藝等有關。對於高速介面設計，雖然有現成的ip核，但主要是實現協議，解析協議甚至改動協議，讓它實現你想要的功能。做硬體如果有不清楚的地方，靠理論學習不可能理解到位的，只有實踐，很多東西你做著做著就懂了，如果一開始不懂也別著急。
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