為什麼今天高速序列匯流排可以在資料傳輸速率上超過傳統的老式並行匯流排?

時間 2021-06-06 18:41:28

1樓:山西海南人

並行傳輸存在通道間干擾的問題,訊號波形會變得不理想,表現為接收端無法識別,而且多個通道一起傳輸時,彼此的傳輸延遲不一,具體參考「木桶原理」,而且需要的快取空間,控制邏輯等也需要占用較多資源。所以,並行傳輸速度提高後會需要解決的問題很多。現在問題似乎解決的差不多了,為了提高資料吞吐量,也會把多個序列通道並用,但需要通道繫結技術等方法。

2樓:norton zhang

新式的怎麼都比老式有優勢啊,你用詞不當。

至於為什麼序列比並行快了,這是很正常的,這兩個總是交替而上的。

沒發現pci被pcie 超過了,又出現了pcie*16永遠都是序列提速,線少了,提不上去了,又並行,線多了。

3樓:H William

不是高速序列快,而是低速並行快不起來;

老式並行快不起來的原因無非在於,雖然位寬高了數倍甚至更多,但頻率卻低了數量級;

頻率上不去的原因無非是並行的高頻單端訊號串擾嚴重、高頻單端訊號要求的擺幅及其需要的功耗太高等等訊號完整性帶來的問題;

高速序列相對傳統序列的突破也無非從驅動方式和傳輸線上著手,用差分、低幅值來大幅提高頻率降低功耗;

所以,最快的還是差分傳輸的高速並行匯流排(GDDR5,HMC),相較多通道高速序列匯流排併聯(PCIE 3.0 x16、HT、QPI)還是可以高出數量級的,不過這些玩意就很難用線纜做板間連線了。

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