1樓：聰明的笨小豬
從我目前的工作來看，沒有用到Python，用到的是perl shell tcl makefile C verilog，排名不分先後。
2樓：張奧蕾
c 不能說額外，本科基礎課。，，。。。那你是Verilog比較熟了，C是基礎必須會。，Python是指令碼，必須會個指令碼、
3樓：海賊藝術家
語言只是工具而已，如果你目前沒有基礎，建議直接從Python入手比較好。Python更適合文字處理。當然看你從事模擬還是數字？
數字的話，寫code本來就是業務內的事。不是什麼問題吧？個人見解。
4樓：謹記
本科積體電路在讀。
硬體描述語言跟軟體語言是不一樣的，我感覺你是站在軟體的角度看待c和py的。
verilog hdl（verilog 硬體描述語言）是必備的，國內本科大二一般（基本全部）學的就是這個。老師說國內都是用verilog的多，美國vhdl比較多。這兩個偏向於底層電路的主要語言。
從系統層面上的語言有system c，system verilog，好像是這麼寫的吧。
硬體的話還是c比較好，更高層次的設計還是用得上c的。
verilog hdl實際上是借用了一些c語法的。你要稍微懂一點硬體描述語言就不會問這樣的問題了。
你要學verilog了，那麼還要學數位電路與邏輯設計，因為硬體描述語言本質不是程式語言，而是描述電路的語言，如果數位電路不會總是不行的吧。
至於Python，硬體完全用不上的吧。而且c怎麼能說額外掌握？無論硬體軟體，c都是本分。
在硬體描述語言的學習中，應該是不太可能出現verilog，vhdl，c，c＋＋以外的字眼的。
水平有限，如果有謬誤的話，包含。
5樓：謝丹
Python。
不知道什麼時候開始，積體電路回答也要政治正確了：A不能偏廢、B不能弱、C也要強。
做為晶元前端，其實最核心的是verilog 與systemC，如果要額外掌握，掌握Python。
Python的好處在於能快速驗證想法，以及人工智慧方面的資源。
乙個人要往科技的前沿去看，前端寫RTL，估計也就還有5-10年的前途，以後會被人工智慧代替。
學會python，你可能成為獲益者而不是被淘汰者。
有寫python的想法，就是因為你有創新的需求。把這種創新堅持下去，比糾結學什麼語言重要多了。
6樓：數字晶元實驗室
樓上路哥威武的回答挺好的。先表明觀點，c是基本功，python是選修項。
現在的晶元很多都是soc，這裡面的軟體部分都是用c語言編譯成的二進位制檔案。
python，或者說其他指令碼都是用來提高工作效率的，shell，perl，tcl，makefile等隨著工作經驗的積累，和提高效率的需要會慢慢掌握的。實際上，也只是需要掌握這些指令碼的一小部分內容即可。看懂，會除錯很關鍵。
基本原理的掌握是最可貴的，不然搬磚也搬的不踏實。
7樓：hainabc
首先，工具只是用來提高你的效率的，主要目的是節省重複大量不必要的體力勞動，具體語言和你做的工作相關。
所以其次就需要你定位前段設計工程師的職責，需不需要寫演算法還是做rtl實現，還是只做soc整合。每乙個工作側重點不同，需要的輔助語言也有差異。寫演算法，c是一定要需要精通的，至於Python,matlab等也是需要的，看你習慣用哪個。
只寫rtl實現c是需要懂的，hdl等語言是要精通的，python或者其他語言就是輔助了。到soc整合c就用的很少了，python 可能就用的多一點了。
當然，如上都是大體而言，設計分工很細很多，需要你發覺自己的興趣，精通最需要的語言，其他作為輔助。
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