FPGA高速採集波形發生變化,求原因

時間 2021-06-09 10:30:08

1樓:

我遇到過類似的問題,但是我不確定我的經驗能幫助你解決問題。

我曾經用single tap去抓波形的時候,完全抓不出資料。而被採集的資料卻能正常讀出資料,雖然資料不正確,但是和single tap採集的資料完全不一樣。後來我提高了採集頻率。

就能讀出資料了,這個的原因在於採集頻率過低,產生了柵欄效應。

2樓:林名

採集精度由你的取樣時鐘和管腳速率有關。取樣深度只是表示存了多少點而已,和波形沒有必然聯絡。你先了解一下數電和fpga原理再說。然後查下你的時序約束

3樓:Evan172

這種情況我也遇到過,一般加identify或chipscope時,只加4K,太大時出過問題。

你檢視一下RAM使用率是多少?有種可能是RAM占用太多,導致其它模組使用RAM時被擠到很遠的地方,導致佈線出現問題。

另外,取樣點是reg型別的嗎?扇出大不?如果是wire型或本身扇出很大,加入取樣點後可能也會影響佈線結果,導致功能出錯。

PS,再來一招,試著例化兩個IUA,深度為16K,一邊只抓一半的資料寬度,再試試。

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